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Alcuni degli argomenti trattati in questo eBook di ingegneria sono:
1. Memorie a semiconduttore: Introduzione e tipi
2. Memoria di sola lettura (ROM)
3. Cella DRAM a tre transistor
4. Una cella DRAM a transistor
5. Memoria flash
6. Circuiti logici CMOS a bassa potenza: Introduzione
7. Progettazione di inverter CMOS
8. Inverter MOS: introduzione alle caratteristiche di commutazione
9. Tecniche basate sulla scansione
10. Tecniche di autotest integrato (BIST).
11. Prospettiva storica del VLSI Design: la legge di Moore
12. Classificazione dei tipi di circuiti digitali CMOS
13. Un esempio di progettazione di circuiti
14. Metodologie di progettazione VLSI
15. Flusso di progettazione VLSI
16. Gerarchia di progettazione
17. Concetto di regolarità, modularità e località
18. Fabbricazione CMOS
19. Flusso del processo di fabbricazione: passaggi di base
20. Fabbricazione del transistor nMOS
21. Fabbricazione CMOS: processo p-well
22. Fabbricazione CMOS: processo n-well
23. Fabbricazione CMOS: processo a doppia vasca
24. Diagrammi stick e design del layout della maschera
25. Transistore MOS: struttura fisica
26. Il sistema MOS sotto bias esterno
27. Struttura e funzionamento del MOSFET
28. La tensione di soglia
29. Caratteristiche della tensione di corrente del MOSFET
30. Ridimensionamento del Mosfet
31. Effetti del ridimensionamento
32. Effetti di piccola geometria
33. Capacità MOS
34. Invertitore MOS
35. Caratteristiche di trasferimento di tensione (VTC) dell'inverter MOS
36. Inverter con carico MOSFET di tipo n
37. Invertitore di carico resistivo
38. Progettazione di inverter a carico di esaurimento
39. Invertitore CMOS
40. Definizioni del tempo di ritardo
41. Calcolo dei tempi di ritardo
42. Progettazione dell'inverter con vincoli di ritardo: esempio
43. Circuiti logici MOS combinati: introduzione
44. Circuiti logici MOS con carichi nMOS a esaurimento: Gate NOR a due ingressi
45. Circuiti logici MOS con carichi nMOS a esaurimento: struttura NOR generalizzata con ingressi multipli
46. Circuiti logici MOS con carichi nMOS ad esaurimento: Analisi transitoria della porta NOR
47. Circuiti logici MOS con carichi nMOS a esaurimento: Gate NAND a due ingressi
48. Circuiti logici MOS con carichi nMOS a esaurimento: struttura NAND generalizzata con ingressi multipli
49. Circuiti logici MOS con carichi nMOS ad esaurimento: Analisi transitoria della porta NAND
50. Circuiti logici CMOS: porta NOR2 (due ingressi NOR).
51. Porta CMOS NAND2 (NAND a due ingressi).
52. Layout di semplici porte logiche CMOS
53. Circuiti logici complessi
54. Porte logiche CMOS complesse
55. Layout di porte logiche CMOS complesse
56. Cancelli AOI e OAI
57. Porte pseudo-nMOS
58. Circuito CMOS Full-Adder e trasporta il sommatore di ondulazione
59. Porte di trasmissione CMOS (porte di passaggio)
60. Logica pass-transistor complementare (CPL)
61. Circuiti logici MOS sequenziali: Introduzione
62. Comportamento degli elementi bistabili
63. Il circuito SR Latch
64. Chiusura SR con clock
65. Chiusura JK con orologio
66. Flip-Flop Master-Slave
67. CMOS D-Latch e Flip-Flop con trigger edge
68. Circuiti logici dinamici: Introduzione
69. Principi di base dei circuiti a transistor di passaggio
Tutti gli argomenti non sono elencati a causa di limitazioni di carattere.
Ogni argomento è completo di diagrammi, equazioni e altre forme di rappresentazioni grafiche per un migliore apprendimento e una rapida comprensione.
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